Student Thesis STUD-2226

BibliographySchaal, Marcel: Parallele Fehlersimulation auf GPGPUs.
University of Stuttgart, Faculty of Computer Science, Electrical Engineering, and Information Technology, Student Thesis No. 2226 (2009).
73 pages, german.
CR-SchemaB.7.1 (Integrated Circuits, Types and Design Styles)
B.8.1 (Reliability, Testing, and Fault-Tolerance)
C.1.4 (Processor Architectures, Parallel Architectures)
C.4 (Performance of Systems)
D.1.3 (Concurrent Programming)
J.6 (Computer-Aided Engineering)
Abstract

In der hier erarbeiteten Studienarbeit wurde gezeigt, dass sich GPGPUs zur Beschleunigung von Fehlersimulation nutzen lassen und dass die algorithmischen Optimierungen für herkömmliche Prozessoren auch auf GPGPUs umsetzbar sind. Die durschnittliche Beschleunigung um circa den Faktor neun demonstriert, dass sich diese Abbildung effizient nutzen lässt. Bei den GPGPUs und Many-Core-Prozessoren stehen als nächste Entwicklungsschritte NVIDIA Fermi und Intel Larabee[SCS+08] auf der Agenda. Der Vorteil dieser beiden Ansätze ist, dass Zwischenspeicher für den Hauptspeicherzugriff eingeführt werden. Dies verbessert die Latenz beim Zugriff auf den Hauptspeicher und die Speicherzugriffsmuster bei der GPGPU-Implementierung sind relativ gut vorraussagbar, da zum Einen die Werte aus einem kleinem räumlichen Bereich, dem Kegel, gelesen werden und zum Anderen wird durch die topologisch sortierte Auswertung ein Wert immer aus der vorherigen Ebene gelesen, welcher zeitnah zuvor ausgewertet wurde. Somit sind zeitliche wie auch räumliche Lokalitäten ausnutzbar.

Full text and
other links
PDF (656338 Bytes)
Access to students' publications restricted to the faculty due to current privacy regulations
Department(s)University of Stuttgart, Institute of Technical Computer Science, Computer Architecture
Superviser(s)Zöllin, Christian; Kochte, Michael
Entry dateApril 27, 2010
   Publ. Computer Science